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干货 | PCIe 5.0更新及测试挑战

发布时间:2020-11-17

浏览次数:25

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图1 PCIE5.0规范进程

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图2 PCIE6.0规范箭在弦上

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图3 PCIE5.0 CEM规范定义的链路裕量分配

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图10  PCIE5.0 CEM TX测试带宽


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图14 Base Spec PCIe 5.0 REF CLK测试说明

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图15 REF CLK测试示意图

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图16 PCIE5.0 RX测试校准点示意图

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图17  PCIE5.0 RX测试校准组网图

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图20  Keysight PCIE5.0/6.0仿真和物理层测试方案

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参考文献:

【1】https://www.synopsys.com/designware-ip/videos/pci-express.html?playlistVideoId=5997531321001

【2】https://members.pcisig.com/wg/PCI-SIG/document/13106

【3】https://www.design-reuse.com/news/48818/synopsys-pci-express-5-0-ip-interoperability-intel-s-xeon-scalable-processor.html

【4】https://members.pcisig.com/wg/PCI-SIG-WG_Members/document/14570

【5】https://members.pcisig.com/wg/PCI-SIG-WG_Members/document/14966

【6】https://members.pcisig.com/wg/PCI-SIG/document/folder/506


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