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发布时间: 2019 - 09 - 04
【干货】沧海桑田话抖动(下)原创: 是德科技KEYSIGHT 是德科技KEYSIGHT 今天 上期内容回顾: 01. 抖动研究的源起02. 抖动测试和分析的基本方法和经典理论03. 抖动测试的演进和新挑战(上)▲  点击回顾上期精彩内容上期关于抖动测试的专题介绍,得到了不少测试行业从业者的喜爱。本期继续推出抖动测试的下篇,主要包括如下主题:03. 抖动测试的演进和新挑战(下)04. 影响抖动测试结果和精度的因素05. 从抖动测试到相噪测试——实时示波器的新战场抖动测试的演进和新挑战(下)上期提到,数据中存在XTALK引起ABUJ抖动时频谱法分析RJ产生误差。那么Keysight EZJIT Plus如何解决这一新的问题和挑战呢?在EZJIT Plus软件里增加了Tail Fit方法进行RJ提取,如下图所示:图17  EZJIT PLUS软件里增加Tail Fit法提取RJ这一方法指的就是在实时示波器的抖动分析软件里采用双狄拉克模型法进行RJ提取:图18 Tail Fit法RJ拟合示意图在以往未使用高斯拟合的原因是由于总直方图中的点稀缺,曲线拟合的点数仍然很少,它会给你带来不稳定的结果。下图显示了针对一个数据信号存在和不存在串扰情况下分别采用频谱法和高斯尾部拟合法对比的结果。左边显示的是无串扰情况下分别采用频谱法和高斯法结果相近,右边显示在有串扰情况下,频谱方法得到的RJ明显偏大,采用高斯法后得到的RJ结果就显然回归正常。图19  高斯法和Tail Fit两种方法分别对存在和不存在串扰引起的ABUJ分离差异对比除了采用高斯尾部拟合法外,为了获得更高精度的测量,还可以先关闭相邻通道的串扰源,进行一次抖动测量并记录RJrms结果,打...
发布时间: 2019 - 08 - 28
【干货】沧海桑田话抖动(上)如果要评选电子工程师近20年来的最耳熟能详的专业词汇,眼图和抖动作为孪生姊妹一定在前10之列。所以业界关于抖动的论述和文章也是时常见诸各种媒体和平台。本期微信头条,小K也将就抖动测试做一个专题介绍,本期主要包括如下主题:01. 抖动研究的源起02. 抖动测试和分析的基本方法和经典理论03. 抖动测试的演进和新挑战(上)(本篇共 6000 字左右,预计需要 20 分钟,分时阅读建议浮窗观看。)抖动研究的源起抖动测试最早在上个世纪80年代开始萌芽,HP公司电信网络测试部门-苏格兰科技公司1982年在苏格兰推出了针对PDH(Plesiochronous Digital Hierarchy,准同步数字体系)的第一个抖动测量仪器,速率高达E3和DS3,之后在1984年推出首批140 Mb / s抖动测试仪之一。在90年代推出针对SONET / SDH抖动测试产品和方案。事实上在同步数字传输体系(SONET/SDH)和通讯系统中引入抖动的概念主要用于评估数据包级的传输延时偏差。因此大家也可以看到经典抖动定义也来自于当年的业界巨擘贝尔实验室。进入90年代以后,随着数字电路系统中的源同步时钟总线的发展,由于外部同步时钟频率渐渐成为瓶颈开始转向嵌入式时钟的串行差分总线,非常典型的就是PCI总线同步时钟频率最高到133MHz就开始转向PCIE1.0 2.5Gbps发展。由此对数字电路系统中的水平时间参数的测量也从传统的Setup/Hold或Skew测量转为水平方向Jitter的测量。在今天,抖动测试除了是很多高速串行总线和标准的一致性测试众多项目中的重要组成部分和内容,同时还是针对系统级传输性能评估的重要方法,以及探究系统问题根源的重要手段。因此对抖动进行深入的探索和研究无论何时都具有深刻的意义和价值。抖动测试和分析的基本方法和经典理论...
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发布时间: 2019 - 08 - 21
如果您需要捕获的信号是低占空比脉冲或猝发信号,并且信号之间有较长的空闲时间(例如封包串行数据),那么配有分段存储器的示波器可以有效地延长时间并提高以较高采样率捕获的串行数据包数量。所有示波器都具有数量有限的采集存储器。您应当知道,示波器的存储器深度决定波形时间和以特定采样率捕获到的串行数据包数量。您可以将示波器的时基设为很慢的时间 / 格设置,以便延长捕获时间间隔并增加串行数据包数量;但是当时基设置超出基于最高采样率下的最大时间间隔时,示波器便会自动降低采样率。在这种情况下,示波器无法提供精确的水平和垂直波形细节(基于示波器的指定带宽和最大采样率)。为什么需要分段存储?如果需要捕获较长时间和更多的串行数据包,同时仍在高采样率下进行数字化处理,只需购买配备更深存储的示波器即可。然而,配有千兆级采集存储器的示波器非常昂贵。如果需要采集的信号在重要波形分段(例如低占空比脉冲或串行数据包猝发)之间具有较长的信号空闲时间,那么具有分段存储器采集功能的示波器是更为经济的解决方案。【捕获时间 = 存储深度 / 采样率】通过将示波器的可用采集存储器划分为较小的存储器分段,分段存储采集模式可以有效地延长示波器的总采集时间。示波器可以在高采样率下,有选择性地针对被测波形的重要部分进行数字化处理。由此,示波器能够以极快的重新准备时间捕获很多的连续单次波形,同时不会错过重要的信号信息。
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沧海桑田话抖动(下)

日期: 2019-09-04
浏览次数: 34

【干货】沧海桑田话抖动(下)

 是德科技KEYSIGHT 是德科技KEYSIGHT 今天

沧海桑田话抖动(下)

 上期内容回顾: 

01. 抖动研究的源起

02. 抖动测试和分析的基本方法和经典理论

03. 抖动测试的演进和新挑战(上)

沧海桑田话抖动(下)

  点击回顾上期精彩内容

上期关于抖动测试的专题介绍,得到了不少测试行业从业者的喜爱。本期继续推出抖动测试下篇主要包括如下主题:

03. 抖动测试的演进和新挑战(下)

04. 影响抖动测试结果和精度的因素

05. 从抖动测试到相噪测试——实时示波器的新战场



沧海桑田话抖动(下)

抖动测试的演进和新挑战(下)

上期提到,数据中存在XTALK引起ABUJ抖动时频谱法分析RJ产生误差。那么Keysight EZJIT Plus如何解决这一新的问题和挑战呢?

在EZJIT Plus软件里增加了Tail Fit方法进行RJ提取,如下图所示:

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图17  EZJIT PLUS软件里增加Tail Fit法提取RJ


这一方法指的就是在实时示波器的抖动分析软件里采用双狄拉克模型法进行RJ提取:

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图18 Tail Fit法RJ拟合示意图


在以往未使用高斯拟合的原因是由于总直方图中的点稀缺,曲线拟合的点数仍然很少,它会给你带来不稳定的结果。下图显示了针对一个数据信号存在和不存在串扰情况下分别采用频谱法和高斯尾部拟合法对比的结果。

左边显示的是无串扰情况下分别采用频谱法高斯法结果相近,右边显示在有串扰情况下,频谱方法得到的RJ明显偏大,采用高斯法后得到的RJ结果就显然回归正常。

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图19  高斯法和Tail Fit两种方法分别对存在和不存在串扰引起的ABUJ分离差异对比


除了采用高斯尾部拟合法外,为了获得更高精度的测量,还可以先关闭相邻通道的串扰源,进行一次抖动测量并记录RJrms结果,打开串扰源,在下图中指定RJrms,然后再进行抖动测量,ABUJ就被归入有界抖动,不会被归入RJ成分并可准确得到,而TJ也可准确得到。

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图20  EZJIT PLUS软件里手动去除RJ分析ABUJ示意图


近10年左右,除了在信号水平方向进行更加深入的抖动分析外,在信号的垂直方向进行噪声和干扰分析也慢慢开始兴起,但相比水平方向的抖动对眼图关闭和系统BER影响的理论比较成熟,业界在垂直方向噪声和干扰对垂直方向眼图闭合分析的理论依然在发展中。

垂直方向噪声干扰对信号传输的影响的分析功能目前在Keysight采样示波器N1000系列的 N1010100A软件包和实时示波器的 EZJIT Complete 软件中均可支持:

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图21   EZJIT软件3个等级提供强大的测量和分析能力


抖动测量和分析的理论将一直随着被研究的信号标准的发展而发展,因此其步伐也不会停止,因此本文所列演进和挑战也只能是略举一二例罢了。



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影响抖动测试结果和精度的因素

抖动测量和分析在今天的串行数据电路设计和测试中的重要意义不言而喻,因此如何进行精确测量当然也成为每个工程师都关心的问题。

首先针对被测信号在示波器上要做出正确的测量设置。这些正确设置包括恰当的垂直刻度设置,通常建议信号在垂直刻度方向占满7格左右即用足垂直显示精度。


水平方向主要包括足够的采样率设置和存储深度,对实时采样示波器而言,采样率应当满足所用带宽的2.5倍以上。存储深度不足导致波形采集数据不足可能会导致实时示波器不能进行正确的时钟恢复。太长的存储深度则会导致数据波形过大,运算速度变慢。


因此建议按照规范或标准数据量捕获波形进行分析,比如部分标准或规范通常推荐1M UI进行分析,USB3.x和PCIE3.0即是如此,当然到PCIE4.0已经更改为2M UI。


对一般性串行数据抖动分析,应当达到100K UI量级数据以上。有时部分标准需要进行SSC(扩频时钟)测量,如果进行手动分析,建议根据需要测量的SSC周期数和所用采样率计算恰当的采样深度。


另外针对信号的阈值(Threshold)设置迟滞(Hysteresis)设置也非常关键,通常建议设置信号幅度一半的电平为阈值,差分总线通常为0V。


针对一些有共模偏置的信号建议先手动测量信号幅度和共模电压以选取准确的阈值。准确迟滞设置也非常重要,因为可以避免示波器将信号边沿上的一些因为反射导致的不连续误判为ISI抖动的一个bit。


如下图示,左边设置的迟滞门限较低,因此会将波形上升沿上的一个回勾当作一个有效bit,显然这会被归入ISI抖动,右边迟滞设置电平门限拉高就会对这个回勾忽略不计。

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图22 准确的迟滞设置避免将波形回勾计为一个bit的ISI抖动

如果想获得准确TIE测量结果,还有一个必须强调的是准确的遵循被测信号规范设置的时钟恢复算法,这是实时示波器进行抖动分析和分解的重要基础。相关信息请阅读各标准规范。


其它还包括在上期提到的关于EZJIT Plus如何进行抖动分解的一些设置,比如ISI滤波器的大小(Filter Size),Rj带宽等等。


总之,如果要进行一次准确的抖动分析和测量,涉及的知识非常广泛的,操作也略显繁琐。因此在对抖动测试不甚熟悉的情况下建议使用示波器上的抖动测试向导(Setup Wizard),抖动向导会对信号进行自动设置,包括信号刻度及阈值和迟滞等。建议安装Keysight实时示波器离线软件D9010BSEO进一步深入了解。


除了操作层面外,仪器的哪些指标对抖动测量的结果和精度会有比较大的影响呢?或者如何选择一个恰当的示波器完成预设的目标或工作呢?

首先是测量系统的恰当带宽。

测量系统带宽包括示波器和探头与电缆及夹具等连接部件等,如果不符合标准和规范要求,低于规范要求带宽则会带来信号输入链路额外的ISI抖动。

在今天已经普遍应用的针对电缆夹具和探头的去嵌技术如N2809A—Precision Probe和包含InfiniiSim的D9020ASIA分析套件也可以部分解决这些效应,当然也会带来额外的副作用即同步放大了仪器的本底噪声,必然带来额外误差。过高带宽也是不推荐的,因为会引入更多的高频带噪声。

其次实时示波器的采样率也会有影响。

通常更高采样率会有更高精度。显而易见,更高采样率会有更高的分辨率和边沿解析度,对最终的抖动分析结果会有影响。

下图是源自第三方的Jitter Labs针对PCIE Gen4 /Gen5时钟测量结果对比,可以看到Keysight 90000A和90000X(当前替代型号是V系列)与T公司及L公司另两款产品测试结果对比。

红色为20/25GSa/s,蓝色为40G/50GSa/s,绿色为80/100GSa/s,Post-Channel和Pre-Channel指对PCIE Gen4/Gen5时钟测试的不同测试点位置。很明显在同型号产品上更高采样率得到的结果更好。K公司产品对比T/L产品相对结果明显更优,这又是什么原因呢?

沧海桑田话抖动(下)

图23 不同型号示波器不同采样率测试结果对比

第三,仪器的本底噪声和固有抖动。

Keysight公司产品相比业界其它公司产品有更低的噪声本底和固有抖动,因此在上图Jitter Lab测量对比结果中显示出更高的精度。

一般实时示波器在采用频谱法进行抖动分析时都会采用功率谱密度积分得到RJrms值,频谱法进行功率谱积分时会将示波器的宽频本底噪声带入到RJ的分析结果中,带来更多的误差。而仪器的固有抖动也是误差之源,参考如下公式:

沧海桑田话抖动(下)

从公式中还可以看出噪声本底和信号本身的跳变斜率(Slew Rate)相关。在今天越来越低的信号幅度,越来越快的边沿,越来越低的裕量测试场景下,典型如PCIExpress规范里对CC CLK的CC Jitter描述,在32GT/s,CC Jitter Limits达0.15ps RMS,对实时示波器的测量精度提出了更高要求:

沧海桑田话抖动(下)

图24  PCIExpress5.0规范对CC Jitter Limit的要求


为了满足这些标准和规范的最新要求,业界除了在算法上做出一些改进和提高外,Keysight公司在EZJIT Plus/Complete软件里提供了去除示波器本身的随机抖动和噪声的选项,从而去除测量误差提高测量精度。

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图25 EZJIT COMPLETE软件提供去除示波器随机抖动和噪声功能


另外捕获足够时长的波形用于数据分析也是抖动测试中的一个关键。

因为足够的波形数据和捕获时长除了可以捕获更多的时钟周期或数据UI进行更准确的抖动分析外也意味着可以捕获更低频的抖动因为捕获的整个波形周期更长,这也是示波器长存储的重要价值之一。

因此在选择和购买示波器的时候,推荐选择具有更长存储深度配置的产品。

以上谈到了实时示波器的4个影响抖动测量精度的主要因素或指标,虽然抖动软件的分析算法一直与时代同步进行提高和改进,但是在实际工作中尽量选择更高精度的设备依然是获得高精度的测量结果的最有力保障。



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从抖动测试到相噪测试——实时示波器的新战场

实时示波器因为其高采样率下长存储和重复单次采样能力在抖动分析应用领域成为主力设备。随着数据速率的持续提高,裕量的下降,比如前面提到的PCIE5.0规范中关于CC Jitter 的要求,仅从时域角度进行测量已经显得捉衿见肘。

另一方面随着近几年实时示波器的ADC位数从8bit向10bit全面升级,实时示波器的无杂散动态范围(Spurious Free Dynamic Range)等指标得到了全面提高,典型如Keysight公司的 S和UXR系列实时示波器已经实现了从500MHz--8GHz和13--110GHz 硬件10bit ADC的全天候覆盖,其本身的SFDR指标均非常优异。因此实时示波器也开始进入频域指标测量领域,比如相位噪声,Phase Noise。

首先来看什么是相位噪声?

在维基百科中,相位噪声的定义是“时域不稳定性(抖动)导致波形在相位上发生快速、短期、随机的波动,这种波动在频域中的表现即为相位噪声”。这一术语中的“噪声”一词告诉我们,它指的不是杂散或确定性波动。

定义中提到的“短期”是为了与确定时钟源纯净度时所用的其他方法加以区别,例如以百万分之几(ppm)为单位的稳定度。它通常是以更大的时间长度进行测量,例如秒或分钟。

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图26  理想与真实信号在时域和频域的对比


虽然有许多技术术语可以量化相位噪声,但最常采用的指标之一是“单边带(SSB)相位噪声”,L(f)。在数学上,美国国家标准与技术研究院(NIST)将L(f)定义为从载波的偏移频率处的功率密度与载波信号的总功率之比,单位为dBc/Hz:

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基于频域相噪的测量结果可以再转化为时域的相位抖动,这就是数字和时域研究人员感兴趣的结果。如下图示,相位抖动可以对阴影频带范围内相噪进行积分得到。

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图27  基于相噪测量得到相位抖动


对于传统的数字领域的公司和工程师而言,如果为了测试相位噪声而专门进行相位噪声测量仪器的投资,很明显其性价比是不高的。因此发掘现有设备的潜能让其发挥更大作用,也是一个不错的选择,而普遍存在的实时示波器当然是最佳的选择。

相比其它频域仪器测量方法,采用实时示波器进行相噪分析的优点除了节约投资外主要还有实时示波器可以测量方波时钟信号或者带SSC(扩频时钟)的时钟信号相噪,尤其是SSC扩频时钟在高速串行数据标准如PCIExpress/USB等参考时钟信号里是相当常见的。

另外采用实时示波器的方法可以测量100MHz以上的时钟频率偏移,而频域仪器一般限定在100MHz范围内。针对数字域常见的差分信号,示波器可以采用高阻探头直接探测或者采用2个通道输入再进行差分运算,无需额外的附件Balun(巴伦)。

当然实时示波器还可以直接测量传递到数据信号上的相位噪声。实时示波器还有强大的数据存储和记录能力可以保存波形用于传统的数字分析工具比如PCIExpress 标准的CLK Jitter Tool等。

总而言之采用实时示波器进行相位噪声的分析和测试,不仅可以挥实时示波器的作用节约投资,而且针对频域测量仪器在数字标准和信号上的不足提供了更多优点:

  • 支持更广泛信号类型

  • 更广泛的时钟信号如方波、带SSC时钟、数据信号

  • 更简便丰富的连接方式无需Balun以及探头

  • 更轻松的电缆接入

  • 更大的频率偏移支持能力

  • ……


Keysight公司在2018年推出了基于Infinium系列实时示波器的D9010/D9020JITA抖动/噪声/相噪分析软件,除了包含EZJIT Complete的全部功能外,还提供了功能强大的相噪测试功能:

  • 将单边带(SSB)相位噪声绘制为对数频率与dBc / Hz

  • 使用2个通道和交叉相关来降低宽带测量噪声

  • 通过降低宽带测量噪声来测量差分时钟的相位噪声

  • 测量带扩频调制(SSC)时钟的相位噪声

  • 减少交叉相关时间间隔误差(TIE)测量中的宽带噪声(RJ)

  • 在相位噪声图上测量两个频率之间的积分抖动

  • 使用InfiniiMax探头测量电路中的时钟/数据相位噪声

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图28  D9010/D9020 JITA软件相噪测试设置


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图29  D9010/9020 JITA 单边带相位(SSB)噪声测量结果


基于相噪测量结果,然后在测量菜单下选择FFT →Phase Jitter项目,参照下图,选择感兴趣的频带,就可以得到Phase Jitter测量结果,如下图示:

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图30 基于相噪测试结果的相位抖动测量


为了获得更精确的测量结果,相噪测试时还可以进行2-通道互相关降低仪器本底噪声。时钟信号通过功分分成两个信号输入到示波器的两个通道,可以执行双通道互相关技术。

时钟信号可以是单端或差分(如果差分信号则建议分别针对正负信号经过功分后用SMA电缆接入1-3或2-4通道)。然后在通道上执行互相关操作,如下图30所示。

通过每个通道的DUT噪声是相干的并且不受互相关的影响,而每个通道产生的内部噪声是不相干的,并且以或者的速率通过互相关运算减少,其中M是进行波形相关运算的采集数量,采用的波形相关运算数量越大则进行平均运算时的速度越慢。

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图31  双通道互相关降低仪器本底噪声示意


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图32  相关运算数量和降低噪声性能对应关系


相噪测试为实时示波器进入频域测量打开了另一扇窗户,尤其是针对数字和时域信号日益增长的频域测试需求。

安装了D9010/D9020 JITA选件的Keysight Infinium系列实时示波器当前业界唯一提供相噪测试功能的实时示波器平台。D9010JITO则是配合可安装在PC上的离线示波器软件D9010BSEO的抖动和相噪分析选件。

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如果您想体验D9010/D9020 JITA功能强大的抖动/噪声分析和分解软件,以及最新相噪测试应用软件

请登录www.keysight.com查找并下载D9010BSEO--Infinium Offline软件并安装在PC上,您可以直接在官网上申请30天免费试用许可,欢迎登记填写调查问卷申请更长试用许可。

您也可以在www.keysight.com为您的Keysight Infinium实时示波器申请30天的D9010/9020JITA试用许可(请注意示波器的平台软件版本必须在6.30以上)。

购买新机时则可以直接购买D9010/9020JITA选件,将会包含所有抖动/噪声分析分解及相噪分析和测试功能。另外,Keysight还提供:

  • D9010BSEO—Infinium Offline软件永久使用许可购买

  • D9010JITO EJJIT Complete离线分析选件

 结语 

本文就20多年来抖动测试和分析的相关源起和基本方法,近年的演进,以及最新的对相位噪声和抖动测试需求的挑战,并就Keysight公司基于实时示波器的应对方案和一些有意义的探索做了一个全面的回顾总结和新方法的介绍。

因为篇幅关于实时示波器的经典抖动分析分解算法和说明只是将基本步骤和理论做了简单陈述,进一步的深入研究请查阅相关参考文献。

另外相比之下,采样示波器主要用于通讯领域的高速眼图测量并延伸到抖动和噪声分析,在本文未作为重点说明。

限于篇幅和作者水平,必然存在许多错漏之处,欢迎邮件探讨:teng_huang@keysight.com

抖动是一门持续发展和博大精深的学问,本文未尽之处,请参考附录参考文献。更多文献和资料请登录www.keysight.com  网站及其它相关渠道。


参考文献:

Ref[1]: Jitter Analysis: The dual-Dirac Model,RJ/DJ,and Q-Scale. Keysight Technologies,5989-3206EN

Ref[2]: Finding Sources of Jitter with Real-Time Jitter Analysis. Keysight Technologies,5888-0740EN

Ref[3]: Analyzing Jitter Using EZJIT Plus Software. Keysight Technologies,5989-3776EN

Ref[4]: Selecting RJ Bandwidth in EZJIT Plus Software. Keysight Technologies,5989-5065EN

Ref[5]: Choosing the ISI Filter Size for EZJIT Plus Arbitrary Data Jitter Analysis.  Keysight Technologies,5989-4974EN

Ref[6]: PCI ExpressTM Jitter Modeling Revision 1.0RD, PCI-Sig.

Ref[7]: PCIE4.0 Base Specfication.PCI-Sig.

Ref[8]: PCIE5.0 Base Specification.PCI-sig.

Ref[9]: UXR Series Datasheet.Keysight Technologies,5992-3132EN

Ref[10]: Infiinum Help Manual




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